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403Webshell
Server IP : 104.225.223.251  /  Your IP : 216.73.216.41
Web Server : Apache/2.4.41 (Ubuntu)
System : Linux agtdemo03 5.4.0-216-generic #236-Ubuntu SMP Fri Apr 11 19:53:21 UTC 2025 x86_64
User : root ( 0)
PHP Version : 7.4.3-4ubuntu2.29
Disable Function : pcntl_alarm,pcntl_fork,pcntl_waitpid,pcntl_wait,pcntl_wifexited,pcntl_wifstopped,pcntl_wifsignaled,pcntl_wifcontinued,pcntl_wexitstatus,pcntl_wtermsig,pcntl_wstopsig,pcntl_signal,pcntl_signal_get_handler,pcntl_signal_dispatch,pcntl_get_last_error,pcntl_strerror,pcntl_sigprocmask,pcntl_sigwaitinfo,pcntl_sigtimedwait,pcntl_exec,pcntl_getpriority,pcntl_setpriority,pcntl_async_signals,pcntl_unshare,
MySQL : OFF  |  cURL : ON  |  WGET : ON  |  Perl : ON  |  Python : OFF  |  Sudo : ON  |  Pkexec : ON
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/* SPDX-License-Identifier: GPL-2.0-only */
/*
 * Copyright (c) 2014, The Linux Foundation. All rights reserved.
 */

#ifndef _DT_BINDINGS_CLK_APQ_GCC_8084_H
#define _DT_BINDINGS_CLK_APQ_GCC_8084_H

#define GPLL0						0
#define GPLL0_VOTE					1
#define GPLL1						2
#define GPLL1_VOTE					3
#define GPLL2						4
#define GPLL2_VOTE					5
#define GPLL3						6
#define GPLL3_VOTE					7
#define GPLL4						8
#define GPLL4_VOTE					9
#define CONFIG_NOC_CLK_SRC				10
#define PERIPH_NOC_CLK_SRC				11
#define SYSTEM_NOC_CLK_SRC				12
#define BLSP_UART_SIM_CLK_SRC				13
#define QDSS_TSCTR_CLK_SRC				14
#define UFS_AXI_CLK_SRC					15
#define RPM_CLK_SRC					16
#define KPSS_AHB_CLK_SRC				17
#define QDSS_AT_CLK_SRC					18
#define BIMC_DDR_CLK_SRC				19
#define USB30_MASTER_CLK_SRC				20
#define USB30_SEC_MASTER_CLK_SRC			21
#define USB_HSIC_AHB_CLK_SRC				22
#define MMSS_BIMC_GFX_CLK_SRC				23
#define QDSS_STM_CLK_SRC				24
#define ACC_CLK_SRC					25
#define SEC_CTRL_CLK_SRC				26
#define BLSP1_QUP1_I2C_APPS_CLK_SRC			27
#define BLSP1_QUP1_SPI_APPS_CLK_SRC			28
#define BLSP1_QUP2_I2C_APPS_CLK_SRC			29
#define BLSP1_QUP2_SPI_APPS_CLK_SRC			30
#define BLSP1_QUP3_I2C_APPS_CLK_SRC			31
#define BLSP1_QUP3_SPI_APPS_CLK_SRC			32
#define BLSP1_QUP4_I2C_APPS_CLK_SRC			33
#define BLSP1_QUP4_SPI_APPS_CLK_SRC			34
#define BLSP1_QUP5_I2C_APPS_CLK_SRC			35
#define BLSP1_QUP5_SPI_APPS_CLK_SRC			36
#define BLSP1_QUP6_I2C_APPS_CLK_SRC			37
#define BLSP1_QUP6_SPI_APPS_CLK_SRC			38
#define BLSP1_UART1_APPS_CLK_SRC			39
#define BLSP1_UART2_APPS_CLK_SRC			40
#define BLSP1_UART3_APPS_CLK_SRC			41
#define BLSP1_UART4_APPS_CLK_SRC			42
#define BLSP1_UART5_APPS_CLK_SRC			43
#define BLSP1_UART6_APPS_CLK_SRC			44
#define BLSP2_QUP1_I2C_APPS_CLK_SRC			45
#define BLSP2_QUP1_SPI_APPS_CLK_SRC			46
#define BLSP2_QUP2_I2C_APPS_CLK_SRC			47
#define BLSP2_QUP2_SPI_APPS_CLK_SRC			48
#define BLSP2_QUP3_I2C_APPS_CLK_SRC			49
#define BLSP2_QUP3_SPI_APPS_CLK_SRC			50
#define BLSP2_QUP4_I2C_APPS_CLK_SRC			51
#define BLSP2_QUP4_SPI_APPS_CLK_SRC			52
#define BLSP2_QUP5_I2C_APPS_CLK_SRC			53
#define BLSP2_QUP5_SPI_APPS_CLK_SRC			54
#define BLSP2_QUP6_I2C_APPS_CLK_SRC			55
#define BLSP2_QUP6_SPI_APPS_CLK_SRC			56
#define BLSP2_UART1_APPS_CLK_SRC			57
#define BLSP2_UART2_APPS_CLK_SRC			58
#define BLSP2_UART3_APPS_CLK_SRC			59
#define BLSP2_UART4_APPS_CLK_SRC			60
#define BLSP2_UART5_APPS_CLK_SRC			61
#define BLSP2_UART6_APPS_CLK_SRC			62
#define CE1_CLK_SRC					63
#define CE2_CLK_SRC					64
#define CE3_CLK_SRC					65
#define GP1_CLK_SRC					66
#define GP2_CLK_SRC					67
#define GP3_CLK_SRC					68
#define PDM2_CLK_SRC					69
#define QDSS_TRACECLKIN_CLK_SRC				70
#define RBCPR_CLK_SRC					71
#define SATA_ASIC0_CLK_SRC				72
#define SATA_PMALIVE_CLK_SRC				73
#define SATA_RX_CLK_SRC					74
#define SATA_RX_OOB_CLK_SRC				75
#define SDCC1_APPS_CLK_SRC				76
#define SDCC2_APPS_CLK_SRC				77
#define SDCC3_APPS_CLK_SRC				78
#define SDCC4_APPS_CLK_SRC				79
#define GCC_SNOC_BUS_TIMEOUT0_AHB_CLK			80
#define SPMI_AHB_CLK_SRC				81
#define SPMI_SER_CLK_SRC				82
#define TSIF_REF_CLK_SRC				83
#define USB30_MOCK_UTMI_CLK_SRC				84
#define USB30_SEC_MOCK_UTMI_CLK_SRC			85
#define USB_HS_SYSTEM_CLK_SRC				86
#define USB_HSIC_CLK_SRC				87
#define USB_HSIC_IO_CAL_CLK_SRC				88
#define USB_HSIC_MOCK_UTMI_CLK_SRC			89
#define USB_HSIC_SYSTEM_CLK_SRC				90
#define GCC_BAM_DMA_AHB_CLK				91
#define GCC_BAM_DMA_INACTIVITY_TIMERS_CLK		92
#define DDR_CLK_SRC					93
#define GCC_BIMC_CFG_AHB_CLK				94
#define GCC_BIMC_CLK					95
#define GCC_BIMC_KPSS_AXI_CLK				96
#define GCC_BIMC_SLEEP_CLK				97
#define GCC_BIMC_SYSNOC_AXI_CLK				98
#define GCC_BIMC_XO_CLK					99
#define GCC_BLSP1_AHB_CLK				100
#define GCC_BLSP1_SLEEP_CLK				101
#define GCC_BLSP1_QUP1_I2C_APPS_CLK			102
#define GCC_BLSP1_QUP1_SPI_APPS_CLK			103
#define GCC_BLSP1_QUP2_I2C_APPS_CLK			104
#define GCC_BLSP1_QUP2_SPI_APPS_CLK			105
#define GCC_BLSP1_QUP3_I2C_APPS_CLK			106
#define GCC_BLSP1_QUP3_SPI_APPS_CLK			107
#define GCC_BLSP1_QUP4_I2C_APPS_CLK			108
#define GCC_BLSP1_QUP4_SPI_APPS_CLK			109
#define GCC_BLSP1_QUP5_I2C_APPS_CLK			110
#define GCC_BLSP1_QUP5_SPI_APPS_CLK			111
#define GCC_BLSP1_QUP6_I2C_APPS_CLK			112
#define GCC_BLSP1_QUP6_SPI_APPS_CLK			113
#define GCC_BLSP1_UART1_APPS_CLK			114
#define GCC_BLSP1_UART1_SIM_CLK				115
#define GCC_BLSP1_UART2_APPS_CLK			116
#define GCC_BLSP1_UART2_SIM_CLK				117
#define GCC_BLSP1_UART3_APPS_CLK			118
#define GCC_BLSP1_UART3_SIM_CLK				119
#define GCC_BLSP1_UART4_APPS_CLK			120
#define GCC_BLSP1_UART4_SIM_CLK				121
#define GCC_BLSP1_UART5_APPS_CLK			122
#define GCC_BLSP1_UART5_SIM_CLK				123
#define GCC_BLSP1_UART6_APPS_CLK			124
#define GCC_BLSP1_UART6_SIM_CLK				125
#define GCC_BLSP2_AHB_CLK				126
#define GCC_BLSP2_SLEEP_CLK				127
#define GCC_BLSP2_QUP1_I2C_APPS_CLK			128
#define GCC_BLSP2_QUP1_SPI_APPS_CLK			129
#define GCC_BLSP2_QUP2_I2C_APPS_CLK			130
#define GCC_BLSP2_QUP2_SPI_APPS_CLK			131
#define GCC_BLSP2_QUP3_I2C_APPS_CLK			132
#define GCC_BLSP2_QUP3_SPI_APPS_CLK			133
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#define GCC_BLSP2_QUP4_SPI_APPS_CLK			135
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#define GCC_PCIE_1_SLV_AXI_CLK				332

/* gdscs */
#define USB_HS_HSIC_GDSC				0
#define PCIE0_GDSC					1
#define PCIE1_GDSC					2
#define USB30_GDSC					3

#endif

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